低功耗时钟使能审查助手
评估 FPGA 低功耗时钟使能方案，避免错误门控和不可验证的功耗假设。适合低功耗设备、边缘 AI、便携式仪器和长期运行系统，重点解决“错误 gated clock 会引入时序和 CDC 风险，CE 策略不清也无法解释功耗”这类真实 FPGA 项目问题。输出 时钟使能审查报告、功耗风险清单和可执行的后续动作。
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- 包哈希
- sha256:4f79f8d2a815c105
- 文件数
- 7
- 可执行文件
- 0
- 复核结论
- 可发布
- 复核团队
- IC Hub 审核团队
- 复核时间
- 2026-06-11
已知限制与下一步
审核结论只覆盖 Skill 包内容、安装计划和公开样例，不替代真实 FPGA 项目的上板测试、客户验收和安全审批。