Quartus 系统连线审查助手
核对 Quartus Platform Designer 系统连线、地址映射、时钟复位和接口桥接风险。适合Intel/Altera SoC FPGA、Nios、Avalon、AXI 和 Platform Designer/Qsys 工程，重点解决“Platform Designer 连接复杂，错误经常表现为软件无法访问或数据通路卡死”这类真实 FPGA 项目问题。输出 Platform Designer 连线风险表、地址中断核对表和可执行的后续动作。
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- 未发现私钥、云密钥、token 或长通用密钥。
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- 未发现递归删除、云 metadata 访问、编码 shell 或未复核外传动作。
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- 该 Skill 包未包含运行时依赖清单。
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- 该包以文档和参考资料为主，已标记为 dry-run 就绪。
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- 评分 95，等级 A+，通过率 96.6%。
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- 包哈希
- sha256:d65859234a466041
- 文件数
- 7
- 可执行文件
- 0
- 复核结论
- 可发布
- 复核团队
- IC Hub 审核团队
- 复核时间
- 2026-06-11
已知限制与下一步
审核结论只覆盖 Skill 包内容、安装计划和公开样例，不替代真实 FPGA 项目的上板测试、客户验收和安全审批。