CI 回归失败分拣助手
SoC 软件与工程自动化4.8
从 CI 日志和 commit 范围中聚类失败原因,输出 owner、优先级和阻断项
CIDebugVivado
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更新于 06/11
Skill 市场
覆盖高速采集、PCIe DMA、10G Ethernet、Zynq、DDR、板卡调试与交付合规。
按真实 FPGA 场景整理
下载记录可追溯
来自审核与样例门禁
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从 CI 日志和 commit 范围中聚类失败原因,输出 owner、优先级和阻断项
建立可复现 EDA 环境清单和构建入口,降低工具版本和 license 差异导致的失败
对企业私有 FPGA Skill 做发布前安全、依赖、版权和行为审查
从现场资料中提取最小复现条件,生成可共享、可脱敏、可执行的问题包
将现场问题日志整理成可共享的脱敏包,并保留足够复现信息
设计 FPGA CI 回归指标、流水线阶段、失败归因、趋势看板和发布门禁
对 FPGA 交付包进行脱敏审查,识别源码、路径、账号、license、密钥、客户名称和不可公开报告内容
规范 FPGA IP 发布包结构和版本说明,让团队能安全复用和审计
把 FPGA 项目复盘材料整理成可进入知识库或转化为 Skill 的结构化资产
把 FPGA 项目进展、风险、阻塞、测试结果和下周计划整理成周报
将 Vivado/Quartus/Gowin 工程整理为可复现构建包,记录工具版本、IP 版本、路径依赖和一键构建命令
评估 FPGA 开源工具链可行性,输出脚本模板、限制说明和替代建议