Skill 市场

真实项目型 FPGA Skill 目录

覆盖高速采集、PCIe DMA、10G Ethernet、Zynq、DDR、板卡调试与交付合规。

01目录规模
132 个 Skill

按真实 FPGA 场景整理

02累计下载
254,298 次

下载记录可追溯

03质量评分
4.7 平均星级

来自审核与样例门禁

04发布状态
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CI 回归失败分拣助手

SoC 软件与工程自动化4.8
鹏野嘉途v3.0.0

从 CI 日志和 commit 范围中聚类失败原因,输出 owner、优先级和阻断项

CIDebugVivado
已验证1984
更新于 06/11
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DDR 校准与压力测试助手

板卡调试与系统联调4.7
鹏野嘉途v3.0.0

分层定位 DDR 初始化、校准、读写、突发、仲裁、温漂和压力测试问题

DDRILA/SignalTapVivado
已验证1041
更新于 06/11
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EDA 环境复现助手

SoC 软件与工程自动化4.7
鹏野嘉途v3.0.0

建立可复现 EDA 环境清单和构建入口,降低工具版本和 license 差异导致的失败

LicenseVivadoQuartus
已验证1961
更新于 06/11
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EDA 日志定位助手

SoC 软件与工程自动化4.8
鹏野嘉途v3.0.0

分析 EDA 工具日志,归类语法、IP、约束、时序、license、路径、内存和工具版本问题

VivadoQuartusGowin
已验证1317
更新于 06/11
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Floorplan/Pblock 规划助手

约束时序与资源收敛4.7
鹏野嘉途v3.0.0

根据 utilization、timing 和层次结构规划 Pblock/Floorplan 调整方向

PblockTimingVivado
已验证3226
更新于 06/11
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FPGA CI 回归看板助手

SoC 软件与工程自动化4.6
鹏野嘉途v3.0.0

设计 FPGA CI 回归指标、流水线阶段、失败归因、趋势看板和发布门禁

CIVivadoTiming
已验证1340
更新于 06/11
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高扇出网络修复助手

约束时序与资源收敛4.8
鹏野嘉途v3.0.0

分析高扇出网络对 FPGA 时序和布局的影响,输出复制、层次和约束建议

TimingQoRVivado
已验证3249
更新于 06/11
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FPGA Timing 收敛实战助手

约束时序与资源收敛4.7
鹏野嘉途v3.0.0

从 timing report 中定位 FPGA 关键路径,区分约束问题、结构问题、布局问题和工具策略问题

TimingXDCVivado
已验证926
更新于 06/11
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Vivado BD 系统审查助手

方案定义与器件选型4.7
鹏野嘉途v3.0.0

从 BD Tcl、IP 参数和地址分配中识别系统集成风险,给出修复顺序

VivadoZynqAXI
已验证1501
更新于 06/11
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Vivado/Quartus 工程复现助手

SoC 软件与工程自动化4.8
鹏野嘉途v3.0.0

Vivado/Quartus/Gowin 工程整理为可复现构建包,记录工具版本、IP 版本、路径依赖和一键构建命令

VivadoQuartusCI
已验证1294
更新于 06/11
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XDC 管脚与时钟约束助手

约束时序与资源收敛4.7
鹏野嘉途v3.0.0

生成和审查 FPGA 管脚、IOSTANDARD、create_clock、generated_clock、input/output delay、clock group 和约束缺口

XDCTimingVivado
已验证903
更新于 06/11
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